1. Trang chủ
  2. » Giáo Dục - Đào Tạo

(LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA

93 5 0

Đang tải... (xem toàn văn)

Tài liệu hạn chế xem trước, để xem đầy đủ mời bạn chọn Tải xuống

THÔNG TIN TÀI LIỆU

Thông tin cơ bản

Tiêu đề Nghiên Cứu, Thiết Kế Modul Thực Hành FPGA
Tác giả Nguyễn Viết Tuyến
Người hướng dẫn TS. Đặng Văn Chuyết
Trường học Standard format not all caps
Chuyên ngành XLTT – TT
Thể loại thesis
Năm xuất bản 2003
Thành phố Standard format not all caps
Định dạng
Số trang 93
Dung lượng 10,29 MB

Nội dung

Ngày đăng: 18/05/2022, 07:07

HÌNH ẢNH LIÊN QUAN

Hình1. 1: Mạch PLA - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 1. 1: Mạch PLA (Trang 13)
Hình1. 2: Mạch PAL - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 1. 2: Mạch PAL (Trang 13)
bảng tìm kiếm (LUT: - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
bảng t ìm kiếm (LUT: (Trang 15)
Để xây dựng đợc các mạch số phải bắt đầu với bảng chân lý dựa vào các yêu cầu kỹ thuật đa ra.. - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
x ây dựng đợc các mạch số phải bắt đầu với bảng chân lý dựa vào các yêu cầu kỹ thuật đa ra (Trang 16)
1.4.2.2.Các khối logic có thể cấu hình đợc (CLBs: Configurable Logic Blocks) - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
1.4.2.2. Các khối logic có thể cấu hình đợc (CLBs: Configurable Logic Blocks) (Trang 19)
sơ đồ hình 1.7. Có ba bảng Lookup (LUT), đợc dùng làm các bộ tạo hàm, - - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
sơ đồ h ình 1.7. Có ba bảng Lookup (LUT), đợc dùng làm các bộ tạo hàm, - (Trang 20)
Hình1. 9: Sơ đồ khối chức năng của Flip-Flop trong CLB - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 1. 9: Sơ đồ khối chức năng của Flip-Flop trong CLB (Trang 21)
Hình1. 8: Bộ tạo hàm 5 đầu vào - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 1. 8: Bộ tạo hàm 5 đầu vào (Trang 21)
Hình1.1 0: Ghép nối các tín hịêu điều khiển. - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 1.1 0: Ghép nối các tín hịêu điều khiển (Trang 23)
Hình 1.14: Sơ đồ khối chung của các kênh kết nối trong CLB - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 1.14 Sơ đồ khối chung của các kênh kết nối trong CLB (Trang 29)
Hình 1.16: Phân bố mạng tổng thể của Spartan - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 1.16 Phân bố mạng tổng thể của Spartan (Trang 32)
Cấu trúc của một chơng trình VHDL đợc minh hoạ nh hình 2.1. - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
u trúc của một chơng trình VHDL đợc minh hoạ nh hình 2.1 (Trang 37)
Bảng 2.1: Các toán tử và mức độ u tiên - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Bảng 2.1 Các toán tử và mức độ u tiên (Trang 46)
Hình 3.1: Trình tự thiết kế với FPGA - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 3.1 Trình tự thiết kế với FPGA (Trang 60)
Hình 3.2: Sơ đồ khối của modul - (LUẬN văn THẠC sĩ) nghiên cứu, thiết kế modul thực hành FPGA
Hình 3.2 Sơ đồ khối của modul (Trang 62)

TRÍCH ĐOẠN

Các kênh kết nối

Các thuật ngữ của VHDL

Thực thể (Entity)

Các đối tợng dữ liệu

Nạp FPGA và chạy thử

TÀI LIỆU CÙNG NGƯỜI DÙNG

TÀI LIỆU LIÊN QUAN