Giáo trình hình thành giai đoạn hướng dẫn lập trình chăm sóc cây trồng p7 pdf

Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 62 - cho phép ngắt và trạng thái của chân quan hệ với sự lựa chọn chế độ ngắt. ở cấp độ chip, do trạng thái tự nhiên của cổng nối dây OR, ngắt GPIO không phải là ngắt nhạy theo sờn hay ngắt nhạy theo mức. Chúng có thể đợc lựa chọn là nhạy theo sờn nhng nhạy theo mức phải đợc tháo bỏ khỏi đờng ra ngắt của cổng nối dây OR. Nếu không có ngắt GPIO nào đang xác nhận, thì một ngắt GPIO sẽ đợc sinh ra bất cứ khi nào bit cho phép ngắt của một chân GPIO đợc set và chân GPIO chuyển sang cao hoặc thấp một cách thích hợp. Một khi điều này xảy ra, đờng ra của ngắt INTO sẽ đợc kéo xuống thấp để xác nhận ngắt GPIO (Giả định rằng các điều kiện sinh ngắt của hệ thống là cho phép, nh là cho phép ngắt GPIO toàn cục và cho phép ngắt toàn cục). Lu ý rằng cho phép ngắt ở chân có thể xác nhận đầu ra ngắt INTO ngay lập tức, nếu nh điều kiện chế độ ngắt đã sẵn sàng xuất hiện ở chân. Một khi INTO đợc kéo xuống mức thấp, nó sẽ tiếp tục giữ INTO ở mức thấp cho đến khi một trong các điều kiện sau đây thay đổi: - Bit cho phép ngắt ở chân đợc xóa - Điện áp ở chân chuyển đổi sang trạng thái đối lập . - Trong chế độ thay đổi ngắt, thanh ghi dữ liệu đợc đọc, do đó thiết lập mức độ ngắt nội tại sang trạng thái đối lập. - Chế độ ngắt bị thay đổi do đó trạng thái hiện thời của chân không sinh ra ngắt. Khi một trong các điều kiện trên xảy ra thì đầu ra INTO đợc giải phóng. Tại thời điểm này, các chân khác (hoặc chính chân này) có thể xác nhận đầu ra ngắt của nó, kéo đờng chung xuống thấp để xác nhận một ngắt mới. Lu ý rằng nếu một chân đang xác nhận đờng ra ngắt INTO và khi đó một chân khác lại xác nhận đầu ra ngắt của nó thì khi chân trớc giải phóng đờng ra ngắt của nó mà chân thứ hai đã điều khiển đầu ra ngắt INTO của nó thì sẽ không có sự thay đổi nào đợc phát hiện ra ở đầu ra ngắt INTO. Tức là sẽ không có ngắt mới nào đợc xác nhận trên ngắt GPIO. Chú ý, sử dụng AND/OR trạng thái của chân GPIO và của bit cho phép ngắt toàn cục để nắm bắt đợc toàn bộ các ngắt của cổng nối dây OR trong khối GPIO. . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 63 - 4. Hệ thống khối PSoC số Cấu trúc của hệ thống số Hình 3 - 1: Sơ đồ khối mô tả cấu trúc các khối số trong PSoC Những ngoại vi đợc tạo bởi khối PSoC số x Các bộ định thời 8,16,24,32-bit với các đặc điểm sau: Hình 3 - 2: Sơ đồ nguyên lý của bộ định thời - Độ rộng thanh ghi 8, 16, 24, 32 bit, sử dụng 1,2,3,4 khối PSoC theo thứ tự - Xung nhịp nguồn lên tới 48 MHz. - Tự động nạp lại chu kỳ khi đếm xong. - Khả năng chụp (capture) tới 24 MHz. - Đầu ra đếm kết thúc có thể đợc sử dụng nh là đầu vào xung nhịp cho các chức năng số và tơng tự khác. - Lựa chọn chế độ ngắt khi đếm kết thúc hoặc là khi bộ đếm đạt một giá . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 64 - trị đặt trớc. Các Module bộ định thời là những bộ đếm lùi với chu kỳ có thể lập trình đợc, có khả năng chụp giữ. Xung nhịp và các tín hiệu cho phép có thể đợc lựa chọn từ nguồn ngoài hoặc từ xung nhịp hệ thống. Sau khi đã khởi động, Bộ định thời hoạt động liên tục và tự động tải chu kỳ từ thanh ghi chu kỳ mỗi khi đếm kết thúc. Các sự kiện có thể chụp giữ giá trị đếm hiện thời của Timer bằng cách xác nhận sờn xung của tín hiệu chụp giữ ở đầu vào. Trong mỗi chu kỳ, bộ định thời sẽ so sánh giá trị đếm với giá trị so sánh đặt ở trong thanh ghi compare để kiểm tra điều kiện Less than hay Less than or Equal To. Các ngắt có thể đợc sinh ra dựa trên tín hiệu đếm kết thúc hoặc điều kiện so sánh. x Các bộ đếm 8, 16,24,32 bit với những đặc điểm sau: - Độ rộng thanh ghi đếm 8,16,24,32 bit, tơng ứng chiếm 1,2,3,4 khối PSoC. - Xung nhịp có thể lên tới 48 MHz. - Tự động tải lại chu kỳ khi đếm kết thúc. - Độ rộng xung có thể lập trình đợc. - Có đầu vào cho phép/không cho phép hoạt động đếm liên tục. Hình 3 - 3: Sơ đồ nguyên lý của bộ đếm. x Bộ điều chế độ rộng xung 8,16 bit với những đặc điểm sau: . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 65 - - Bộ điều chế độ rộng xung 8 bit hoặc 16 bit sử dụng 1 hoặc 2 khối số. - Nguồn xung nhịp có thể lên tới 48MHz. - Tự động nạp lại giá trị điều chế khi kết thúc một chu kỳ điều chế xung. - Có thể lập trình độ rộng xung. - Mở và khóa ngắt ngay cả khi bộ điều chế đang hoạt động. - Ngắt có thể lựa chọn theo sờn dơng của đầu ra hoặc theo giá trị đếm cuối. - Đầu vào xung nhịp và đầu vào cho phép có thể đợc lựa chọn từ nhiều nguồn khác nhau. - Đầu ra có thể đợc nối tới một chân vào ra hoặc đợc sử dụng nội bộ bên trong chíp PSoC. x Bộ điều chế độ rộng xung 8,16 bit kết hợp với dải an toàn: Chức năng tạo dải an toàn sẽ phát ra tín hiệu trên cả hai đầu ra chính và đầu ra phụ của khối. Chức năng này sinh ra xung nhịp không gối lên nhau. Hai pha xung nhịp đó không bao giờ cùng ở mức cao trong cùng một thời điểm và khoảng thời gian ở giữa hai pha đó đợc gọi là dải an toàn. Độ rộng của dải an toàn đợc quyết định bởi giá trị đặt trớc của thanh ghi. Nếu nguồn xung nhịp là một PWM, thì nó sẽ tạo ra hai đầu ra PWM với đầu ra đảm bảo không gối lên nhau. Một tín hiệu tích cực trên đầu vào Kill sẽ khóa cả hai đầu ra ngay lập tức. x Bộ tạo dãy CRC phục vụ việc kiểm tra lỗi. - Khả năng tạo dãy từ 2 đến 16 bit. - Đầu vào xung nhịp lên tới 48 MHz. - Có thể lập trình đa thức mẫu. - Đầu vào nối tiếp, đầu ra song song. . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 66 - Hình 3 - 4: Sơ đồ nguyên lý của bộ tạo dãy CRC x Bộ truyền thông không đồng bộ UART, TX, RX với những đặc điểm: - Bộ nhận và truyền tín hiệu không đồng bộ. - Định dạng dữ liệu tơng thích với định dạng dữ liệu RS-232. - Tỷ số xung đồng bộ lên tới 6 Mbit/s. - Khung dữ liệu bao gồm bit Start, bit chẵn lẻ (lựa chọn) và các bit Stop - Ngắt khi thanh ghi nhận đầy (lựa chọn) hoặc là khi bộ đệm truyền rỗng. - Phát hiện chẵn lẻ, khung quá tải, khung báo lỗi. - Các chức năng phát và thu ở mức cao. Ngoài ra còn một số ngoại vi số khác của PSoC nh: Bộ truyền thông SPI Master, SPI Slave 5. Hệ thống khối PSoC tơng tự Cấu trúc của hệ thống tơng tự. . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 67 - Hình 3 -5: Sơ đồ khối của hệ thống tơng tự trong PSoC Những ngoại vi đợc tạo bởi khối PSoC tơng tự. x Các bộ khếch đại. a. Bộ khếch đại INSAMP - Instrumentation Amplifier - Độ khuếch đại có thể lập trình từ 2 - 16 hoặc lên tới 93 đối với cấu trúc 3 bộ KĐTT. - Trở kháng vi sai đầu vào cao. - Một đầu ra. - Có thể lựa chọn cấu trúc hai hoặc ba bộ KĐTT. Hình 3 - 6: Sơ đồ nguyên lý bộ khuếch đại INSAMP b. Bộ khuếch đại đảo AMPINV - Inverting Amplifier . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 68 - Hình 3 - 7:Sơ đồ nguyên lý bộ khuếch đại đảo - Độ khuếch đại có thể lập trình từ với 18 cấp, độ khuếch đại tối đa là -47 - Một đầu ra đơn đợc tham chiếu đối với đất của Analog. c. Bộ khuếch đại không đảo PGA - Programmable Gain Amplifier - Độ khuếch đại có thể lập trình từ với 33 cấp, độ khuếch đại tối đa là 48. - Một đầu ra đơn với điện áp tham chiếu có thể lựa chọn. - Trở kháng đầu vào cao Module PGA là một module KĐTT dựa trên bộ khuếch đại không đảo, độ khuếch đại với độ khuếch đại có thể lập trình đợc. Bộ khuếch đại này có trở kháng đầu vào cao, băng thông rộng và điện áp tham chiếu có thể lựa chọn đợc. Hình 3 - 8: Sơ đồ nguyên lý bộ khuếch đại không đảo PGA x Các bộ chuyển đổi tơng tự sang số - ADC. a. ADCINC12 - 12 bit Incremental ADC - Độ phân giải 12 bit, bù 2. - Tốc độ lấy mẫu: 7,8 - 480 mẫu/giây. - Dải đầu vào: AGND V ref. . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 69 - - Hỗ trợ chế độ bình thờng hoặc chế độ khử hài bậc cao. - Xung nhịp bên trong hoặc bên ngoài. Hình 3-9: Sơ đồ nguyên lý bộ chuyển đổi ADC 12-bit Incremental b. ADCINCVR - 7 to 13 bit Variable Resolution Incremental ADC. - Độ phân giải 7 - 13 bit, bù 2. - Tốc độ lấy mẫu: 4 - 10000 mẫu/giây. - Dải đầu vào: V SS -V DD . - Xung nhịp bên trong hoặc bên ngoài. Hình 3-10: Sơ đồ nguyên lý bộ ADCINCVR c. DELSIG8 - 8 bit Deltal Sigma ADC - Độ phân giải 8 bit, bù 2. - Tốc độ lấy mẫu: 32K mẫu/giây. - Dải đầu vào: đợc định nghĩa bởi các lựa chọn tham chiếu trong hoặc ngoài. - Xung nhịp bên trong hoặc bên ngoài. DELSIG8 là một bộ biến đổi A/D có kiểu tích phân hàng đợi, cần phải có 127 . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 70 - chu kỳ tích phân để có đợc một mẫu ở đầu ra. Hình 3-11: Sơ đồ nguyên lý bộ ADC DelSig8 d. DUALADC - Hai bộ ADCINCVR kết hợp với nhau để tạo ra bộ ADC kép. e. TRIADC - Ba bộ ADCINCVR kết hợp với nhau để tạo ra ba bộ ADC. f. SAR6 - 6 bit Successive Apropximation Register. - Độ phân giải 6 bit. - Sử dụng duy nhất một khối PSoC tơng tự. - Thời gian chuyển đổi tiêu biểu là 25ms. - Giao diện lập trình ứng dụng API đợc tối u để đơn giản trong sử dụng. Hình: 3-12 Sơ đồ nguyên lý API Ngoài ra các khối PSoC số còn coa các bộ chuyển đổi DAC, các bộ lọc, các bộ lựa chọn MUX. x Những User Module đợc bổ xung. . Đồ án tốt nghiệp Nguyễn Thái Học - Lớp TĐH 46 Khoa Cơ Điện Trờng ĐHNN I - H Nội - 71 - a. Module Hiển thị Tinh thể lỏng - LCD. - Sử dụng giao thức theo tiêu chuẩn công nghiệp của HITACHI HD44780. - Chỉ yêu cầu sử dụng 7 chân I/O trên một cổng vào ra. - Các hàm hỗ trợ việc in xâu ký tự trong RAM và ROM. - Các hàm hỗ trợ việc in các số. - Các hàm hỗ trợ việc in các thanh đồ họa theo chiều ngang hoặc chiều dọc Module LCD là một tập th viện các chơng trình con để ghi các xâu ký tự và định dạng các số theo một chuẩn chung hai hoặc bốn hàng, các thanh đồ họa ngang hoặc dọc đợc hỗ trợ bằng cách sử dụng những đặc điểm đồ họa hay ký tự của Module LCD này. Module này đợc phát triển đặc biệt dành riêng cho chuẩn công nghiệp của Hitachi HD44780 hai hàng 16 ký tự, nhng vẫn sẽ làm việc cho nhiều màn hiển thị 4 hàng khác. Th viện này sử dụng chế độ giao diện 4-bit để tiết kiệm các chân vào ra cho chíp. Hình: 3-13 Sơ đồ chân của LCD b. Module Truyền thông I2C - Giao diện theo chuẩn công nghiệp I2C của hãng Philips. - Vận hành ở chế độ Master và Slave, có khả năng hỗ trợ nhiều Master. . . chân chuyển đổi sang trạng thái đối lập . - Trong chế độ thay đổi ngắt, thanh ghi dữ liệu đợc đọc, do đó thiết lập mức độ ngắt nội tại sang trạng thái đối lập. - Chế độ ngắt bị thay đổi do. tải lại chu kỳ khi đếm kết thúc. - Độ rộng xung có thể lập trình đợc. - Có đầu vào cho phép/không cho phép hoạt động đếm liên tục. Hình 3 - 3: Sơ đồ nguyên lý của bộ đếm. x Bộ điều chế độ. khóa cả hai đầu ra ngay lập tức. x Bộ tạo dãy CRC phục vụ việc kiểm tra lỗi. - Khả năng tạo dãy từ 2 đến 16 bit. - Đầu vào xung nhịp lên tới 48 MHz. - Có thể lập trình đa thức mẫu. - Đầu