440 V IA và V RA , thay đổi hoặc V IA hoặc V RA là cần thiết để bảo đảm hoạt động chính xác. Xem xét tương tự áp dụng lên chân nạp trong cổng B. Hình 16.26 Sơ đồ khối và các chân của IC CCD 321 B2. 441 Hình 16.27 Mạch điều khiển xung nhịp. Hình 16.28 Mạch phối hợp đầu vào cho nhiều CCD. Hình 16.29 Mạch phối hợp đầu ra cho nhiều CCD. 442 Hình 16.30 Mạch lọc thông thấp để loại bỏ xung nhịp. Chúng ta vừa xem xét thiết kế của Kaufman và một số người khác nữa. Cho các ứng dụng HDTV, các thiết kế sẽ phải dùng các phần tử chất lượng cao hơn như khuếch đại thuật toán Comlinear CLC411 và đa nhiệm Comlinear CLC532. Các phần tử này được thiết kế một cách đặc biệt cho các ứng dụng của truyền hình phân giải cao. CLC411 là một khuếch đại video nguyên khối tốc độ cao 15V với một dải thông 200-Mhz. Tốc độ quét của nó là 2300 V micro giây. CLC532 là một dồn kênh 2:1 có độ biến dạng thấp (80 dBc). Bài tập 16.6 Tôi nghĩ bạn bây giờ tự mình xây dựng mạch điện cho bạn. Cái mà bạn cần làm là xây dựng đúng các khối và các phần tử để bạn bắt đầu. Gọi đến cho một công ty sản xuất CCD (ví dụ như TI hoặc Fairchild Weston) và rút ra một danh sách giá cả và một catalo. Làm tương tự cho các khuếch đại thuật toán video và các bộ dồn kênh. Dựa trên cơ sở tin tức bạn có, thiết kế các mạch điện trễ CCD dùng hai CCD mà có thể dùng cho thiết kế các bộ lọc 2 2 lai hoặc số tương lai. Để xây dựng và kiểm tra mạch bạn cần nguồn cung cấp, một mạch cắm thử, một máy hiện sóng 100 Mhz với một bộ tạo sóng TV và các phần tử pha tạp các. Thiết kế và xây dựng mạch điện dây trễ. Khi bạn chắc chắn thiết kế hoạt động, bạn bắt đầu thiết kế mạch in. Để thực hiện phần này của dự án, bạn cần một phần mềm thiết kế mạch in như HiWIRE II từ tập đoàn Wintek, và phần cứng cho phép bạn làm mạch in. Nếu bạn chưa có khái niệm gì về lĩnh vực này, tôi đề nghị bạn nên đọc cuốn sách J.Goldberg. Đây là một cuốn sách hay (xấp xỉ 100 trang) miêu tả cách tạo một mạch in. 16.8.2 Thiết kế của các phần xử lý tương tự Phần xử lý tương tự tính y(kT,t), và dùng các tổng trọng lượng, biến đổi và tích phân. Các phần tử này được thực hiện bằng Kaufman dùng LM318. Một điểm cần nhớ ở đây là các xung đồng bộ dòng được dùng để xoá điện áp trên các tụ lúc bắt đầu mỗi dòng quét mới. Thiết kế của các mạch điện này rất đơn giản, và chi tiết cho các mạch rời rạc được tìm thấy trong các cuốn sách điện tử như Microelectronic Circuit của Sedra và Smith (xuất bản bởi nhà xuất bản Saunders College), là một phần trong một loạt sách kỹ thuật điện của Holt, Rinehart và Winston. Bài tập 16.7 1. Dùng sơ đồ mạch của hình 16.7 để thực hiện lọc thông cao. Để thiết kế hàm truyền đạt dùng chương trình thiết kế cho trong chương 15. 2. Thiết kế và thực hiện một bộ lọc 2-D răng lược. 443 Thực hiện tiếp theo được đưa ra, cũng bởi Kaufman và những người khác nữa, là một bộ lọc thời gian thực đồng hình dùng cấu trúc tương tự tâm thu 2- D IIR. Kỹ thuật mà ông ấy dùng ở đây là một dạng S/H của mạch điện trong hình 16.15, mà đòi hỏi bốn CCD. Bộ lọc đồng hình cần một mạch logarit đặt trước thiết kế và một mạch đối logarit đặt sau bộ lọc 2-D. Chúng được giới thiệu trong hình 16.31 và 16.32. Các hệ số dùng thực hiện bộ lọc là: a ij 009347 007165 004925 007165 179010 087585 004295 087585 0 46525 . . . . . . . . . Hình 16.31 Mạch đảo logarit. 444 Hình 16.32 Mạch đối logarit. và b ij 10 045083 000833 0 45083 0 26831 0 00681 0 00833 0 00681 000292 . . . . . . . . . Thiết kế của các PE. Sơ đồ mạch điện của một PE được giới thiệu trong hình 16.33. Nó dùng khuếch đại thuật toán EL2020C (Elantec). Đây là một IC nguyên khối tốc độ cao (dải băng 50 MHz) có hồi tiếp dòng, thiết kế đặc biệt cho video và các ứng dụng khác mà đòi hỏi tốc độ quét cao, tiêu tốn ít năng lượng. Khuếch đại thuật toán chất lượng cao hơn (200 Mhz) được thiết kế cho các HDTV và các ứng dụng tốc độ cao khác như EL400 (Elantec) được sản xuất dưới dạng DIP mini 8 chân mà dạng chân ra tương thích với EL2020C. Để thực hiện trễ một điểm, một dây trễ thụ động được dùng. Một điểm trễ thì bằng (63.55 s)/(910 điểm) 70 ns nếu CCD 321 của Fairchild Weston được dùng. Dây trễ thụ động được dùng là 1514-70D (Các thiết bị trễ dữ liệu). Kiểu dây trễ 1514-70D có thời gian trễ T d = 70 ns và đặc tính trở kháng z 0 = 250 . Dây trễ này được sản xuất dưới dạng SIP bốn chân không chiếm nhiều chỗ trên vỉ mạch. Các ảnh của mạch điện cuối cùng được giới thiệu trong hình 16.34 (mạch điện dây trễ) và hình 16.35 (mạch điện đồng hình). Cấu trúc này được kiểm tra trên các ảnh trực tiếp. Hình 16.36 và 16.37 giới thiệu ảnh trước và sau khi lọc 445 dùng thiết kế phần cứng. Tác động lọc đồng hình là rất rõ ràng. Hình 16.33 Mạch thực hiện khuếch đại cho PE. Hình 16.34 Mạch điện dây trễ trên bảng mạch CCD. . cuốn sách J.Goldberg. Đ y là một cuốn sách hay (xấp xỉ 100 trang) miêu tả cách tạo một mạch in. 16.8.2 Thiết kế của các phần xử lý tương tự Phần xử lý tương tự tính y( kT,t), và dùng các tổng. a ij 009 347 007165 0 049 25 007165 179010 087585 0 042 95 087585 0 46 525 . . . . . . . . . Hình 16.31 Mạch đảo logarit. 44 4 Hình 16.32 Mạch đối logarit. và. được dùng. D y trễ thụ động được dùng là 15 14- 70D (Các thiết bị trễ dữ liệu). Kiểu d y trễ 15 14- 70D có thời gian trễ T d = 70 ns và đặc tính trở kháng z 0 = 250 . D y trễ n y được sản xuất