Lựa chọn phần cứng và công cụ thử nghiệm:

CHƢƠNG II : Một số kỹ thuật xử lý ảnh

3.2. Lựa chọn phần cứng và công cụ thử nghiệm:

3.2.1. Giới thiệu kit DE2:

Kit DE2 cung cấp một phƣơng tiện tối ƣu để nghiên cứu về kĩ thuật số, cấu trúc máy tính và FPGA. Kit này sử dụng những công nghệ mới nhất cả về

Ảnh chứa

lỗi Bộ xử lý

Ảnh đã xử

phần cứng lẫn công cụ CAD (computer Aid Design) giúp nghiên cứu đƣợc nhiều ứng dụng khác nhau. Kit cung cấp nhiều đặc điểm phù hợp cho công việc nghiên cứu cũng nhƣ phát triển những hệ thống số thông thƣờng hay những hệ thống multimedia phức tạp. Kit DE2 gồm những linh kiện chính sau:

 Chip Cyclone II 2C35 FPGA 672 pins. Tất cả những linh kiện trên kit đều đƣợc kết nối sẵn với những pin của FPGA, điều này cho phép ngƣời sử dụng có thẻ điều khiển tất cả những linh kiện cũng nhƣ ứng dụng của chúng.

 Rom EPCS16 – Dùng thiết lập cấu hình ban đầu cho thiết bị, hoạt động nối tiếp.

 USB Blaster – Dùng để cài đặt chƣơng trình từ computer cho FPGA, hỗ trợ 2 chế độ: JTAG và AS ( Active Serial ).

 512 – Kbyte SRAM  8 – Mbyte SDRAM  – Mbyte Flash memory  Khe cắm thẻ nhớ SD card.  18 toggle switches

 push-button switches  18 red LEDs

 9 green LEDs

 LED 7 đoạn (7-segments displays)

 LED hiển thị kí tự dùng LCD (16x2 character displays)  Nguồn xung clock 50 MHz và 27 MHz.

 24-bit CD-quality audio CODEC với những đầu cắm line-in, line-out, và  microphone-in.

 VGA DAC (10-bit high-speed triple DACs) với đầu cắm VGA-out.  TV Decoder ( NTSC/PAL) với đầu cắm TV-in.

 Giao tiếp chuẩn RS-232 với đầu cắm 9 pin.  Giao tiếp chuẩn PS/2 cho chuột và bàn phím.  Giao tip USB 2.0 ( cả host lẫn device ).

 Giao tiếp Ethernet 10/100  Giao tiếp hồng ngoại (IrDA)

 Hai cổng kết nối header dùng để giao tiếp với những thiết bị ngoại vi khác mà ngƣời sử dụng muốn kết nối vào kit.

Đi kèm với những đặc tính phần cứng, Altera cũng cung cấp những giao tiếp I/O chuẩn và bảng điều khiener việc truy xuất những linh kiện trên KIT dựa trên phần mềm DE2 Control Panel.

Hình dƣới mô tả các thành phần trên Kit DE2 của hãng Altera.

Hình 3-1. Sơ đồ khối Kit DE2  Chip Cyclone II 2C23 FPGA gồm các bộ phận:

– 33216 Les – 105 khối nhớ M4K – 483840 bít nhớ – 35 embeded multipliers – PLLs – 475 I/O pins

– Fineline BGA 672 – pin package.

 Serial configuration device và USB blaster circuit:

Rom EPCS16 swerial configuration device, USB blaster for programing và user API control, JTAG và AS programming modes

 SRAM

512 Kbyte SRAM memory chip. Đƣợc tổ chức 256K x 16 bits, Có thể truy cập nhƣ là bộ nhớ cho vi xử lí Nios II hoặc truy cập thông qua bảng điều khiển Control Panel

8 Mbyte single data rate synchronous dynamic RAM, Đƣợc tổ chức 1M x 16 bits x 4 Banks. Có thể truy cập nhƣ là bộ nhớ cho vi xử lí Nios II hoặc truy cập thông qua bảng điều khiển Control Panel.

 Flash memory:

4 Mbyte NOR flash memory, 8 bit data bus. Có thể truy cập nhƣ là bộ nhớ cho vi xử lí Nios II hoặc truy cập thông qua bảng điều khiển Control Panel

 Khe cắm thẻ nhớ SD card:

Truy xuất SD card bằng mode SPI, có thể truy cập nhƣ là bộ nhớ cho vi xử lí Nios II với DE2 SD card driver.

 Pushbutton switches:

4 pushbutton switches, hồi phục lại tín hiệu bằng mạch Schmitt trigger. Ở trọng thái bình thƣờng, tín hiệu ở mức cao; khi switch đƣợc nhấn, tín hiệu tạo ra một xung tích cực mức thấp và hồi phục lại trạng thái bính thƣờng mức cao.

 Toggle switches:

18 toggle switches. Khi switch ở vị down thì tín hiệu ở mức thấp, ngƣợc lại thì tín hiệu ở mức cao.

 Clock Inputs:

- Nguồn xung clock 50MHz, Nguồn xung clock 27MHz. Có thể sử dụng nguồn xung clock ngoài thông qua chân SMA.

 Audio Codec:

Wolfson WM8731 24-bit sigma-delta audio CODEC, Đầu cắm Line-in, Line-out, Microphone-in. Tần số lấy mẫu: 8 – 96 KHz, đƣợc ứng dụng cho Mp3 players, recorders, PDAs, smart phones, voice recorders…

 VGA output:

Sử dụng ADV7123 240 MHz triple 10 bit high speed video DAC. Với đầu cắm 15 pin high density D-sub, hỗ trợ độ phân giải 1600x1200 tại 100-Hz refresh rate. Có thể kết hợp với Cyclone II FPGA để thực thi một TV encoder tốc độ cao. NTSC/PAL TV decoder circuit: Sử dụng ADV7181B Multi-format SDTV video decoder, hỗ trợ NTSC (M,J,4.43), PAL (B,D,G,H,I,M,N),

SECAM. Tích hợp 3 ADC 9 bit 54MHz, hoạt động với nguồn xung clock 27 MHz, hỗ trợ composite video, hỗ trợ ngõ ra digital (8bit/16bit.

 Bộ điều khiển 10/100 ethernet:

Tích hợp MAC và PHY với giao tiếp vi xử lí thông thƣờng. Hỗ trợ đƣờng truyền 100 Base – T và 10 Base – T, hỗ trợ hoạt dộng kép tại 10Mb/s và 100Mb/s với auto – MDIX, hoàn toàn tƣơng thích với cấu hình IEEE 802.3u, hỗ trợ IP/TCP/UDP checksum generation và checking.

 USB host/slave controller:

USB 2.0, hỗ trợ truyền dữ liệu tốc độ cao và tốc độ thấp, hỗ trợ USB chủ/khách, hai cổng USB. Cung cấp giao tiếp song song đến bộ vi xử lí, hỗ trợ Nios II bởi Terasic driver, hỗ trợ Programmed I/O (PIO) và Direct Memory Access (DMA).

 Cổng nối tiếp:

Gồm 2 cổng: một cổng giao tiếp RS-232, một cổng giao tiếp PS/2  Cổng giao tiếp hồng ngoại:

Bộ truyền nhận tín hiệu 115.2kb/s, dòng điều khiển LED 32mA, tín hiệu ngõ vào đƣợc xác nhận bởi tích cực cạnh.

Hai đầu nối mở rộng:

2x40 pin của 2 đầu nối mở rộng đƣợc kết nối với 72 pin của Cyclone II I/O và 8 pin power và mass. Đầu nối 40 pin có thể tƣơng thích với cable chuẩn 40 pin dùng cho ổ cứng IDE.

3.2.2. Giới thiệu phần mềm Quartus II

Quartus II là công cụ phần mềm phát triển của hãng Altera, cung cấp môi trƣờng thiết kế toàn diện cho các thiết kế SOPC (hệ thống trên 1 chip khả trình - system on a programmable chip). Đây là phần mềm đóng gói tích hợp đầy đủ phục vụ cho thiết kế logic với các linh kiện logic khả trình PLD, FPGA của Altera, gồm các dòng APEX, Cyclone, FLEX, MAX, Stratix...Quatus II cung cấp các khả năng thiết kế sau:

 Môi trƣờng thiết kế gồm các bản vẽ, sơ đồ khối, công cụ soạn thảo các ngôn ngữ: AHDL, VHDL, và Verilog HDL.

 Là công cụ mạnh để tổng họp logic.

 Khả năng mô phỏng chức năng và thời gian.  Phân tích thời gian.

 Phân tích logic nhúng với công cụ phân tích SignalTap® II.

 Cho phép xuất, tạo và kết nối các file nguồn để tạo ra các file chƣơng trình.

 Tự động định vị lỗi.

 Khả năng lập trình và nhận diện linh kiện.

 Phần mềm Ọuartus II sử dụng bộ tích hợp NativeLink® với các công cụ thiết kế cung cấp việc truyền thông tin liền mạch giữa Quartus với các công cụ thiết kế phần cứng EDA khác.

 Quartus II cũng có thể đọc các file mạch (netlist) EDIF chuẩn, VHDL và Verilog HDL cũng nhƣ tạo ra các file netlist này.

 Quartus II có môi trƣờng thiết kế đồ họa giúp nhà thiết kế dễ dàng viết mã, biên dịch, soát lỗi, mô phỏng...

Với Quartus có thế kết hợp nhiều kiểu file trong 1 dự án thiết kế phân cấp. Có thể dùng bộ công cụ tạo sơ đồ khối (Quartus Block Editor) để tạo ra sơ đồ khối mô tả thiết kế ở mức cao, sau đó dùng các sơ đồ khối khác, các bản vẽ nhƣ: AHDL Text Design Files (.tdf). EDIF Input Files (.edfh VHDL Design Files (.vhd). và Verilog HDL Design Files đế tạo ra thành phần thiết kế mức thấp.

Quartus II cho phép làm việc với nhiều file ở cùng thời điểm, soạn thảo file thiết kế trong khi vấn có thế biên dịch hay chạy mô phỏng các dự án khác. Công cụ biên dịch Quartus II nằm ở trung tâm hệ thống, cung cấp quy trình thiết kế mạnh cho phép tùy biến đế đạt đƣợc thiết kế tối ƣu trong dự án. Công cụ định vị lỗi tự động và các bàn tin cảnh báo khiến việc phát hiện và sửa lỗi trở nên đơn giản hơn.