E A T2 S T1 X1 T0 X0 Bit cho phép = 1 cho phép ngắt
BỘ NHỚ VÀO/RA
Định nghĩa không gian I/O của AT90S8035 được thể hiện ở bảng 2.1
Địa chỉ vào/ra (Địa chỉ SRAM)
Tên CHỨC NĂNG
$3F ($5F) SREG Thanh ghi trạng thái
$3E ($5E) SPH Thanh ghi con trỏ ngăn xếp cao $3D ($5D) SPL Thanh ghi con trỏ ngăn xếp thấp $3B ($5B) GIMSK Thanh ghi mặt nạ ngắt tống quát $3A ($5A) GIFR Thanh ghi cờ ngắt tông quát
$39 ($59) TIMSK Thanh ghi mặt nạ ngắt Timer/counter $38 ($58) TIFR Thanh ghi cờ ngắt Timer/counter $35 ($55) MCUCR Thanh ghi điều khiến tống quát MCU $34 ($45) MCUSR Thanh ghi trạng thái tống quát MCU $33 ($53) TCCRO Thanh ghi điêu khiên Timer/counter 0 $32 ($52) TCNTO Thanh ghi Timer/counter 0
$2F ($4F) TCCRIA Thanh ghi điều khiến A Timer/counter 1 $2E ($4E) TCCRI B Thanh ghi điêu khiên B Timer/counter 1 $2D ($4D) TCNTI H Thanh ghi Timer/counter 1 byte cao $20 ($4c) TCNTI L Thanh ghi Timer/counter 1 byte thấp $2B ($4B) OCRIAH Thanh ghi so sánh A byte cao đầu ra bộ
Timer/counter 1
$2A ($4A) OCR1AL Thanh ghi so sánh A byte thấp đầu ra bộ Timer/counter 1
$29 ($49) OCR1BH Thanh ghi so sánh B byte cao đầu ra $28 ($48) OCR1BL Thanh ghi so sánh B byte thấp đầu ra bộ
Timer/counter 1
$27 ($47) ICR1H T/C 1 nhập vào thanh ghi bắt giữ lại byte cao $26 ($46) ICR1L T/C 1 nhập vào thanh ghi bắt giữ lại byte thấp $25 ($45) TCCR2 Thanh ghi điều khiên bộ Timer/counter 2 $24 ($44) TCNT2 Thanh ghi bộ Timer/counter 2 (8-bit)
$23 ($43) OCR2 Thanh ghi so sánh đầu ra bộ Timer/counter 2 $22 ($42) ASSR Thanh ghi trạng thái kiếu không đông bộ $21 ($4 1 ) VVDTCR Thanh ghi điều khiển Timer Watchdog $1F ($3E) EEARH EEPROM thanh ghi địa chỉ byte cao
$1E ($3E) EEARL EEPROM thanh ghi địa chỉ byte thấp $1D ($3D) EEDR EEPROM thanh ghi dữ liệu
$1C ($3C) EECR EEPRM thanh ghi điều khiển $1B ($3B) PORTA Thanh ghi dữ liệu, cổng A
$1A ($3A) DDRA Hướng thanh ghi dữ liệu, cổng A $19 ($39) PINA Nhập vào các chân cổng A
$18 ($38) PORTB Thanh ghi dữ liệu, cổng B
$17 ($37) DDRB Hướng thanh ghi dữ liệu, cổng B $16 ($36) PINB Nhập vào các chân cổng B
$15 ($35) PORTC Thanh ghi dữ liệu, cổng C
$14 ($34) DDRC Hướng thanh ghi dữ liệu, cổng C $13 ($33) PINC Nhập vào các chân cổng C
$12 ($32) PORTD Thanh ghi dữ liệu, cổng D
$11 ($31) DDRD Hướng thanh ghi dữ liệu, cổng D $10 ($30) PIND Nhập vào các chân cổng D
$0F ($2F) SPDR Vào/ra thanh ghi dữ liệu SPI $0E ($2E) SPSR Thanh ghi trạng thái SPI $0D ($2D) SPCR Thanh ghi điều khiển SPI
$0C ($2C) UDR Vào/ra thanh ghi dữ liệu UART $0B ($2B) USR Thanh ghi trạng thái UART $0A ($2A) UCR Thanh ghi điều khiển UART $09 ($29) UBRR UART Baud thanh ghi tốc độ
$08 ($28) ACSR So sánh thanh ghi điều khiển và thanh ghi trạng thái $07 ($27) ADMUX ADC bộ đa hợp lựa chọn thanh ghi
$06 ($26) ADCSR ADC thanh ghi điều khiển và thanh ghi trạng thái $05 ($25) ADCH Thanh ghi dữ liệu ADC
$04 ($24) ADCL Thanh ghi dữ liệu thấp ADC
Tất cả các chân vượng AT90S8535 và thiết bị ngoại vi được đặt trong không gian vào/ra. Vị trí vào/ra được truy cập bởi lệnh IN và OUT. Việc chuyển dữ liệu giữa 32 thanh ghi đa mục đích và không gian vào/ra. Thanh ghi vào/ra trong phạm vi địa chỉ $00=$1F được trực tiếp tiếp cận bit sử dụng lệnh SBI và CBI. Trong những thanh ghi này giá trị của bits đơn có thể được kiểm tra bằng lệnh SBIS và SBIC, để cập lệnh lập hợp mục cho nhiều chi tiết hơn. Khi sử dụng những lệnh đặc biệt vào/ra IN và OUT địa chỉ vào/ra $00-$3F phải được thực
hiện. Khi địa chỉ thanh ghi vuông như SRAM. S20 phải được thêm vào những địa chỉ này. Tất cả những thanh ghi địa chỉ vào/ral tài liệu này cho thấy với địa chỉ SRAM trong dấu ngoặc.
Để thích hợp với những thiết bị các bit dành riêng cần phải được viết 0 nếu truy cập
Một số cờ trạng thái được xoá bằng cách viết một logic ‘1’ tới chúng. Ghi chú rằng lệnh CBI và SBI sẽ có tác dụng trên tất cả các bits trong thanh ghi vào/ra, viết ‘1’ vào sau bất kỳ cờ dọc nào như là tập hợp, như vậy làm xoá cờ. Lệnh CBI và SBI chỉ làmviệc với thành ghi $00 tới $1F.
Thanh ghi điều khiển thiết bị ngoại vi được giải thích trong những mục sau: